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  來源:中電網

  立即可用的解決方案無縫地將Virtualizer 虛擬原型驗證和HAPS基于FPGA的原型驗證整合在一起，以加速SoC軟件和硬件的開發

亮點：

- 通過一種混合原型同時獲得兩個領域的最佳技術，即無縫地將虛擬原型與基于FPGA的原型連接在一起

- 可更早地開始多核系統級芯片（SoC）的原型驗證，并實現系統級模型的高性能執行，它同時通過硬件接口與外界實時鏈接

- 在虛擬與基于FPGA原型環境之間將SoC的不同設計單元進行分割，以使整個原型的性能最大化

- 通過對新的設計單元使用虛擬原型技術，以及對已有的邏輯使用基于FPGA的原型技術，加速系統的快速形成

- 在基于Virtualizer的環境中，改善除錯可見度和對開發軟件的控制

   可方便地將高性能ARM Cortex處理器模塊、ARM AMBA互聯事務處理器和Synopsys DesignWare IP，與您設計的其它部分一起集成到一個混合原型之中 。

   新思科技公司日前宣布了一種集成化混合原型驗證解決方案，它將Synopsys的Virtualizer虛擬原型驗證和Synopsys基于FPGA的HAPS原型驗證結合在一起，以加速系統級芯片（SoC）硬件和軟件的開發。通過對新設計的功能使用Virtualizer虛擬原型技術和對重用邏輯使用基于FPGA的HAPS原型技術，設計師能夠將設計周期中軟件開發的起始時間提前多達12個月。此外，Synopsys的混合原型設計解決方案可確保設計師加速對硬件/軟件的集成及系統驗證，顯著縮短了整體的產品設計周期。憑借ARM Cortex處理器的高性能模型、基于ARM AMBA協議的事務處理器以及DesignWare IP，開發者可為了最貼近他們的設計需求，而方便地將其基于ARM處理器的設計進行分割分別進入到虛擬的和基于FPGA的原型中。 

   目前，設計師在構建SoC原型時使用兩種相對獨立的方法：基于事務級模型（TLM）的虛擬原型驗證和基于FPGA的原型驗證。虛擬原型驗證通過執行快速TLM而完美地適用于在沒有RTL時加快的軟件開發，并提供了更高效的糾錯和腳本分析。基于FPGA的原型設計可提供周期精準和高性能的執行，以及直接真實接口連接。Synopsys的混合原型設計解決方案將Virtualizer虛擬原型和HAPS基于FPGA原型兩者的優勢精心調和在一起，以使軟件開發和系統集成能在項目周期中更快完成。 

   Synopsys的混合原型驗證解決方案增強了軟件棧驗證，這是因為通過使用Virtualizer虛擬原型可帶來非常高的處理器執行速度。它通過模擬PHY或測試設備直接連接到真實世界，該I/O模型接口疊加在基于FPGA的HAPS上。此外，設計師把已有的RTL 或IP用在基于FPGA的原型和把新功能用在SystemC事務級模型中，這樣的方法在項目開發中可以更快地執行和更早地實現。 

   Synopsys的高性能HAPS通用多資源總線（UMRBus）物理連接，可高效地在虛擬和基于FPGA原型驗證兩種環境之間傳輸數據。預先驗證的、基于HAPS的事務處理器可支持ARM AMBA 2.0 AHB/APB、AXI3、AXI-4和AXI4-Lite互聯，它為設計師在虛擬或基于FPGA的原型驗證環境之間分割SoC設計提供了很大的靈活性，分割可在AMBA 互聯的通常的模塊級邊界進行。與傳統基于FPGA的原型設計相比，使用混合原型中的基于Virtualizer環境的軟件糾錯能力，用戶對正在開發的軟件的寄存器和存儲器文件擁有更大的可見度和控制能力。